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Esse esquema foi introduzido pelo PDP-11, cuja instrução de apenas 16
bits pode gerar 2 endereços de operandos, como mostra a Figura
.
Figure:
Formato de uma instrução
![\begin{figure}
\begin{picture}(8,2)(-3.5,0)
\put(0,1){\framebox (8,1)}
\multiput...
...o}}
\put(6.5,0.7){\makebox(0,0){\scriptsize operando}}
\end{picture}\end{figure}](img74.gif) |
Cada operando é constituído de 3 campos, conforme a
Figura
.
Figure:
Os campos de um operando
![\begin{figure}
\begin{picture}(6,2)(-4.5,0)
\put(0,1){\framebox (6,1)}
\multiput...
...ebox(0,0){\scriptsize I = endere\c{c}amento indireto}}
\end{picture}\end{figure}](img75.gif) |
- modo 00 - registrador: reg contém o operando
- modo 01 - auto-incr: reg é incrementado após uso como
endereço do operando
- modo 10 - auto-decr: reg é decrementado e usado como
endereço do operando
- modo 11 - indexado: conteúdo da palavra seguinte à
instrução é somado com conteúdo do registrador reg
para dar o endereço do operando
Intel e Motorola usam esquemas analógos, porém mais complexos.
Siang Wun Song
2001-09-19